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Quelle  cs35l41.h

  Sprache: C 		 

/* SPDX-License-Identifier: GPL-2.0
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 * linux/sound/cs35l41.h -- Platform data for CS35L41
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 * Copyright (c) 2017-2021 Cirrus Logic Inc.
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 * Author: David Rhodes <david.rhodes@cirrus.com>
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/*test regs for emulation bringup*/
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/*registers populated by OTP*/
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#define CS35L41_NUM_SUPPLIES            2

#define CS35L41_SCLK_MSTR_MASK  0x10
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#define CS35L41_LRCLK_MSTR_MASK  0x01
#define CS35L41_LRCLK_MSTR_SHIFT 0
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#define CS35L41_LRCLK_INV_MASK  0x04
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#define CS35L41_ASP_FMT_SHIFT  8
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#define CS35L41_ASP_DOUT_HIZ_SHIFT 0
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#define CS35L41_ASP_RX1_SLOT_SHIFT 0
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#define CS35L41_ASP_RX2_SLOT_SHIFT 8
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#define CS35L41_ASP_TX_WL_MASK  0x3F
#define CS35L41_ASP_RX_WL_SHIFT  0
#define CS35L41_ASP_TX_WL_SHIFT  0
#define CS35L41_ASP_SOURCE_MASK  0x7F

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#define CS35L41_INPUT_SRC_ASPRX2 0x09
#define CS35L41_INPUT_SRC_VMON  0x18
#define CS35L41_INPUT_SRC_IMON  0x19
#define CS35L41_INPUT_SRC_CLASSH 0x21
#define CS35L41_INPUT_SRC_VPMON  0x28
#define CS35L41_INPUT_SRC_VBSTMON 0x29
#define CS35L41_INPUT_SRC_TEMPMON 0x3A
#define CS35L41_INPUT_SRC_RSVD  0x3B
#define CS35L41_INPUT_DSP_TX1  0x32
#define CS35L41_INPUT_DSP_TX2  0x33

#define CS35L41_WR_PEND_STS_MASK 0x2

#define CS35L41_PLL_CLK_SEL_MASK 0x07
#define CS35L41_PLL_CLK_SEL_SHIFT 0
#define CS35L41_PLL_CLK_EN_MASK  0x10
#define CS35L41_PLL_CLK_EN_SHIFT 4
#define CS35L41_PLL_OPENLOOP_MASK 0x0800
#define CS35L41_PLL_OPENLOOP_SHIFT 11
#define CS35L41_PLLSRC_SCLK  0
#define CS35L41_PLLSRC_LRCLK  1
#define CS35L41_PLLSRC_SELF  3
#define CS35L41_PLLSRC_PDMCLK  4
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#define CS35L41_PLLSRC_SWIRE  7
#define CS35L41_REFCLK_FREQ_MASK 0x7E0
#define CS35L41_REFCLK_FREQ_SHIFT 5

#define CS35L41_GLOBAL_FS_MASK  0x1F
#define CS35L41_GLOBAL_FS_SHIFT  0

#define CS35L41_GLOBAL_EN_MASK  0x01
#define CS35L41_GLOBAL_EN_SHIFT  0
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#define CS35L41_BST_EN_SHIFT  4
#define CS35L41_BST_DIS_FET_OFF  0x00
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#define CS35L41_AMP_EN_MASK  1
#define CS35L41_VMON_EN_MASK  0x1000
#define CS35L41_VMON_EN_SHIFT  12
#define CS35L41_IMON_EN_MASK  0x2000
#define CS35L41_IMON_EN_SHIFT  13

#define CS35L41_PDN_DONE_MASK  0x00800000
#define CS35L41_PDN_DONE_SHIFT  23
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#define CS35L41_PUP_DONE_SHIFT  24

#define CS35L36_PUP_DONE_IRQ_UNMASK 0x5F
#define CS35L36_PUP_DONE_IRQ_MASK 0xBF
#define CS35L41_SYNC_EN_MASK  BIT(8)

#define CS35L41_AMP_SHORT_ERR  0x80000000
#define CS35L41_BST_SHORT_ERR  0x0100
#define CS35L41_TEMP_WARN  0x8000
#define CS35L41_TEMP_ERR  0x00020000
#define CS35L41_BST_OVP_ERR  0x40
#define CS35L41_BST_DCM_UVP_ERR  0x80
#define CS35L41_OTP_BOOT_DONE  0x02
#define CS35L41_PLL_UNLOCK  0x10
#define CS35L41_PLL_LOCK  BIT(1)
#define CS35L41_OTP_BOOT_ERR  0x80000000

#define CS35L41_AMP_SHORT_ERR_RLS 0x02
#define CS35L41_BST_SHORT_ERR_RLS 0x04
#define CS35L41_BST_OVP_ERR_RLS  0x08
#define CS35L41_BST_UVP_ERR_RLS  0x10
#define CS35L41_TEMP_WARN_ERR_RLS 0x20
#define CS35L41_TEMP_ERR_RLS  0x40

#define CS35L41_AMP_SHORT_ERR_RLS_SHIFT 1
#define CS35L41_BST_SHORT_ERR_RLS_SHIFT 2
#define CS35L41_BST_OVP_ERR_RLS_SHIFT 3
#define CS35L41_BST_UVP_ERR_RLS_SHIFT 4
#define CS35L41_TEMP_WARN_ERR_RLS_SHIFT 5
#define CS35L41_TEMP_ERR_RLS_SHIFT 6

#define CS35L41_INT1_MASK_DEFAULT 0x7FFCFE3F
#define CS35L41_INT1_UNMASK_PUP  0xFEFFFFFF
#define CS35L41_INT1_UNMASK_PDN  0xFF7FFFFF
#define CS35L41_INT3_PLL_LOCK_SHIFT 1
#define CS35L41_INT3_PLL_LOCK_MASK BIT(CS35L41_INT3_PLL_LOCK_SHIFT)

#define CS35L41_GPIO_DIR_MASK  0x80000000
#define CS35L41_GPIO_DIR_SHIFT  31
#define CS35L41_GPIO1_CTRL_MASK  0x00030000
#define CS35L41_GPIO1_CTRL_SHIFT 16
#define CS35L41_GPIO2_CTRL_MASK  0x07000000
#define CS35L41_GPIO2_CTRL_SHIFT 24
#define CS35L41_GPIO_LVL_SHIFT  15
#define CS35L41_GPIO_LVL_MASK  BIT(CS35L41_GPIO_LVL_SHIFT)
#define CS35L41_GPIO_POL_MASK  0x1000
#define CS35L41_GPIO_POL_SHIFT  12

#define CS35L41_AMP_INV_PCM_SHIFT 14
#define CS35L41_AMP_INV_PCM_MASK BIT(CS35L41_AMP_INV_PCM_SHIFT)
#define CS35L41_AMP_PCM_VOL_SHIFT 3
#define CS35L41_AMP_PCM_VOL_MASK (0x7FF << 3)
#define CS35L41_AMP_PCM_VOL_MUTE 0x4CF

#define CS35L41_CHIP_ID   0x35a40
#define CS35L41R_CHIP_ID  0x35b40
#define CS35L41_MTLREVID_MASK  0x0F
#define CS35L41_REVID_A0  0xA0
#define CS35L41_REVID_B0  0xB0
#define CS35L41_REVID_B2  0xB2

#define CS35L41_HALO_CORE_RESET  0x00000200
#define CS35L41_SOFTWARE_RESET  0x5A000000

#define CS35L41_FS1_WINDOW_MASK  0x000007FF
#define CS35L41_FS2_WINDOW_MASK  0x00FFF800
#define CS35L41_FS2_WINDOW_SHIFT 12

#define CS35L41_SPI_MAX_FREQ  4000000
#define CS35L41_REGSTRIDE  4

enum cs35l41_boost_type {
 CS35L41_INT_BOOST,
 CS35L41_EXT_BOOST,
 CS35L41_SHD_BOOST_ACTV,
 CS35L41_SHD_BOOST_PASS,

 // Not present in Binding Documentation, so no system should use this value.
 // This value is only used in CLSA0100 Laptop
 CS35L41_EXT_BOOST_NO_VSPK_SWITCH,
};

enum cs35l41_clk_ids {
 CS35L41_CLKID_SCLK = 0,
 CS35L41_CLKID_LRCLK = 1,
 CS35L41_CLKID_MCLK = 4,
};

enum cs35l41_gpio1_func {
 CS35L41_GPIO1_HIZ,
 CS35L41_GPIO1_GPIO,
 CS35L41_GPIO1_MDSYNC,
 CS35L41_GPIO1_MCLK,
 CS35L41_GPIO1_PDM_CLK,
 CS35L41_GPIO1_PDM_DATA,
};

enum cs35l41_gpio2_func {
 CS35L41_GPIO2_HIZ,
 CS35L41_GPIO2_GPIO,
 CS35L41_GPIO2_INT_OPEN_DRAIN,
 CS35L41_GPIO2_MCLK,
 CS35L41_GPIO2_INT_PUSH_PULL_LOW,
 CS35L41_GPIO2_INT_PUSH_PULL_HIGH,
 CS35L41_GPIO2_PDM_CLK,
 CS35L41_GPIO2_PDM_DATA,
};

struct cs35l41_gpio_cfg {
 bool valid;
 bool pol_inv;
 bool out_en;
 unsigned int func;
};

struct cs35l41_hw_cfg {
 bool valid;
 int bst_ind;
 int bst_ipk;
 int bst_cap;
 int dout_hiz;
 struct cs35l41_gpio_cfg gpio1;
 struct cs35l41_gpio_cfg gpio2;
 unsigned int spk_pos;

 enum cs35l41_boost_type bst_type;
};

struct cs35l41_otp_packed_element_t {
 u32 reg;
 u8 shift;
 u8 size;
};

struct cs35l41_otp_map_element_t {
 u32 id;
 u32 num_elements;
 const struct cs35l41_otp_packed_element_t *map;
 u32 bit_offset;
 u32 word_offset;
};

enum cs35l41_cspl_mbox_status {
 CSPL_MBOX_STS_ERROR = U32_MAX,
 CSPL_MBOX_STS_ERROR2 = 0x00ffffff, // firmware not always sign-extending 24-bit value
 CSPL_MBOX_STS_RUNNING = 0,
 CSPL_MBOX_STS_PAUSED = 1,
 CSPL_MBOX_STS_RDY_FOR_REINIT = 2,
};

enum cs35l41_cspl_mbox_cmd {
 CSPL_MBOX_CMD_NONE = 0,
 CSPL_MBOX_CMD_PAUSE = 1,
 CSPL_MBOX_CMD_RESUME = 2,
 CSPL_MBOX_CMD_REINIT = 3,
 CSPL_MBOX_CMD_STOP_PRE_REINIT = 4,
 CSPL_MBOX_CMD_HIBERNATE = 5,
 CSPL_MBOX_CMD_OUT_OF_HIBERNATE = 6,
 CSPL_MBOX_CMD_SPK_OUT_ENABLE = 7,
 CSPL_MBOX_CMD_UNKNOWN_CMD = -1,
 CSPL_MBOX_CMD_INVALID_SEQUENCE = -2,
};

/*
 * IRQs
 */
#define CS35L41_IRQ(_irq, _name, _hand)  \
 {     \
  .irq = CS35L41_ ## _irq ## _IRQ,\
  .name = _name,   \
  .handler = _hand,  \
 }

struct cs35l41_irq {
 int irq;
 const char *name;
 irqreturn_t (*handler)(int irq, void *data);
};

#define CS35L41_REG_IRQ(_reg, _irq)     \
 [CS35L41_ ## _irq ## _IRQ] = {     \
  .reg_offset = (CS35L41_ ## _reg) - CS35L41_IRQ1_STATUS1,\
  .mask = CS35L41_ ## _irq ## _MASK   \
 }

/* (0x0000E010) CS35L41_IRQ1_STATUS1 */
#define CS35L41_BST_OVP_ERR_SHIFT  6
#define CS35L41_BST_OVP_ERR_MASK  BIT(CS35L41_BST_OVP_ERR_SHIFT)
#define CS35L41_BST_DCM_UVP_ERR_SHIFT  7
#define CS35L41_BST_DCM_UVP_ERR_MASK  BIT(CS35L41_BST_DCM_UVP_ERR_SHIFT)
#define CS35L41_BST_SHORT_ERR_SHIFT  8
#define CS35L41_BST_SHORT_ERR_MASK  BIT(CS35L41_BST_SHORT_ERR_SHIFT)
#define CS35L41_TEMP_WARN_SHIFT   15
#define CS35L41_TEMP_WARN_MASK   BIT(CS35L41_TEMP_WARN_SHIFT)
#define CS35L41_TEMP_ERR_SHIFT   17
#define CS35L41_TEMP_ERR_MASK   BIT(CS35L41_TEMP_ERR_SHIFT)
#define CS35L41_AMP_SHORT_ERR_SHIFT  31
#define CS35L41_AMP_SHORT_ERR_MASK  BIT(CS35L41_AMP_SHORT_ERR_SHIFT)

enum cs35l41_irq_list {
 CS35L41_BST_OVP_ERR_IRQ,
 CS35L41_BST_DCM_UVP_ERR_IRQ,
 CS35L41_BST_SHORT_ERR_IRQ,
 CS35L41_TEMP_WARN_IRQ,
 CS35L41_TEMP_ERR_IRQ,
 CS35L41_AMP_SHORT_ERR_IRQ,

 CS35L41_NUM_IRQ
};

extern struct regmap_config cs35l41_regmap_i2c;
extern struct regmap_config cs35l41_regmap_spi;

int cs35l41_test_key_unlock(struct device *dev, struct regmap *regmap);
int cs35l41_test_key_lock(struct device *dev, struct regmap *regmap);
int cs35l41_otp_unpack(struct device *dev, struct regmap *regmap);
int cs35l41_register_errata_patch(struct device *dev, struct regmap *reg, unsigned int reg_revid);
int cs35l41_set_channels(struct device *dev, struct regmap *reg,
    unsigned int tx_num, const unsigned int *tx_slot,
    unsigned int rx_num, const unsigned int *rx_slot);
int cs35l41_gpio_config(struct regmap *regmap, struct cs35l41_hw_cfg *hw_cfg);
void cs35l41_configure_cs_dsp(struct device *dev, struct regmap *reg, struct cs_dsp *dsp);
int cs35l41_set_cspl_mbox_cmd(struct device *dev, struct regmap *regmap,
         enum cs35l41_cspl_mbox_cmd cmd);
int cs35l41_write_fs_errata(struct device *dev, struct regmap *regmap);
int cs35l41_enter_hibernate(struct device *dev, struct regmap *regmap,
       enum cs35l41_boost_type b_type);
int cs35l41_exit_hibernate(struct device *dev, struct regmap *regmap);
int cs35l41_init_boost(struct device *dev, struct regmap *regmap,
         struct cs35l41_hw_cfg *hw_cfg);
bool cs35l41_safe_reset(struct regmap *regmap, enum cs35l41_boost_type b_type);
int cs35l41_mdsync_up(struct regmap *regmap);
int cs35l41_global_enable(struct device *dev, struct regmap *regmap, enum cs35l41_boost_type b_type,
     int enable, struct cs_dsp *dsp);

#endif /* __CS35L41_H */

Messung V0.5 in Prozent
C=91 H=94 G=92

¤ Dauer der Verarbeitung: 0.14 Sekunden  (vorverarbeitet am  2026-06-08) ¤

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Bemerkung:

Die farbliche Syntaxdarstellung und die Messung sind noch experimentell.